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13.DDR时钟差分更正

5.0时长 00:48:02·   3084人已学习

讲师：郑振宇    PCB设计总监

13.DDR时钟差分更正课程介绍

整个系列主要从实战角度给大家讲解如何进行6层核心板高速PCB设计，本系列课程分为七章，第一章是原理图的编译检查，第二章是封装库的匹配检查，第三章是PCB设计时常用参数的设置，第四章PCB设计的布局，第五章PCB设计的布线，第六章PCB后期处理，第七章DRC检查、Gerber输出。

 

本节课程讲解DDR时钟差分更正，之前DDR发现了一对差分，现在对这个差分进行走线的更正，详细讲解走线更正时的具体操作。

 

学习获得：

通过这个课程，你可以

1、对实际项目中PCB原理图的编译检查、封装库匹配检查、常用参数设置、布局、布线、后期处理、DRC检查、Gerber输出等流程和实际操作有清晰的了解。

2、快速高效学习PCB设计知识

3、提升技术，提高职场竞争力

 

适合学习人群：

1、对PCB设计感兴趣的同学（含电子信息类的大学生，工程研发技术人员，电子爱好者等）；

2、对PCB设计有所了解但是没有实战经验的同学；

3、工作中需要用到PCB设计相关知识的人群；

4、希望提升技术水平，获得更高薪水的工程师；


课程介绍系列课程课程评分

13.DDR时钟差分更正该课程被包含在以下专栏中

Altium Designer 6层核心板高速PCB设计速成实战教程

5.0   共13个课时· 3084人已学习
￥168.80原价￥268.80

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